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第7题
设计以下3变量组合逻辑电路： （1)判奇电路。输入中有奇数个1时，输出为1，否则为0。 （2)判偶电路。输入中有偶数
设计以下3变量组合逻辑电路：
(1)判奇电路。输入中有奇数个1时，输出为1，否则为0。
(2)判偶电路。输入中有偶数个1时，输出为1，否则为0。
(3)判一致电路。输入变量取值相同时，输出为1，否则为0。
(4)判不一致电路。输入变量取值不一致时，输出为1，否则为0。
(5)被3整除电路。输入能被3整除时，输出为1，否则为0。
(6)A，B，C多数表决电路。有2个或2个以上为1时输出才为1，但C有否决权。
第9题
设计一个时序电路，它有两个输入X1和X0、一个输出Z0只有当X1;输入三个(或三个以上)1后，X0再输入一个1时，输出Z为1,而在同一时刻两个输入不同时为1,一旦Z=1,电路就回到原始状态。这里，X1输入三个1并不要求连续，只要其间没有X0=1插人即可。
设计一个时序电路，它有两个输入X1和X0、一个输出Z0只有当X1;输入三个（或三个以上)1后，X0再输入一个1时，输出Z为1,而在同一时刻两个输入不同时为1,一旦Z=1,电路就回到原始状态。这里，X1输入三个1并不要求连续，只要其间没有X0=1插人即可。
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