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[主观题]

n位异步二进制加法计数器由n个()组成，最低位触发器的时钟端与()相连;如果触发器的时钟是下降

n位异步二进制加法计数器由n个（)组成，最低位触发器的时钟端与（)相连;如果触发器的时钟是下降

沿有效，则高位触发器的时钟端与相邻低位触发器的()相连;如果是上升沿有效，则与()相连。

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第1题

图P7.14是用16x4位ROM和问步十六进制加法计数器74LS161组成的脉冲分频电路,ROM的数据表如表P7

.14所示.试画出在CLK信号连续作用下D₃、D₂、D1、和D₀输出的电压波形,并说明它们与CLK信号频率之比.

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第2题

用4位二进制同步可逆计数器T4193和必要的逻辑门实现模12加法计数器。

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第3题

回答下列问题（1)用7个T'触发器连接成异步二进制计数器,输入时钟脉冲的频率f=512kHz,求此计数器最高位触发器输出的脉冲频率.（2)若需要每输入1024个脉冲,分频器能输出一个脉冲,则此分频器需要多少个触发界连接而成？

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第4题

在计算机中，一个字节(byte)由()位二进制组成。

A.2

B.4

C.8

D.16

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第5题

STC单片机定时器中的硬件计数器是两个八位二进制计数器串联。（)

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第6题

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.(根据二-十进制数的加法运算规则,当两数之和小于、等于9(1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9(即等于1010~111)时,则应在按二进制数相加的结果上加6(0110),这样就以给出进位信号,同时得到一个小于9的和.)

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.（根据二-十进制数的加法运算规则,当两数之和小于、等于9（1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9（即等于1010~111)时,则应在按二进制数相加的结果上加6（0110),这样就以给出进位信号,同时得到一个小于9的和.)

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第7题

IP地址有_________位二进制数组成．

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第8题

用（)电路构成模8计数器的译码电路最简.

A.同步计数器

B.异步计数器

C.环型计数器

D.扭环型计数器

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第9题

经过有限个Clk，可由任意一个无效状态进入有效状态的计数器是能自启动计数器。（)

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第10题

电子计数器一般由输入电路、逻辑控制电路（)、（)和计数显示电路等基本单元电路组成。

电子计数器一般由输入电路、逻辑控制电路()、()和计数显示电路等基本单元电路组成。

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第11题

硅整流发电机的整流器由个二极管组成。此题为判断题(对，错)。

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