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[主观题]

试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为

试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为

试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为试用JK(2)控制端X=1时,计数器的模M=4,计数规律为

试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为试用JK试画出逻辑电路图。

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第1题
试用JK触发器设计一个模4的可逆计数器。要求控制端X=1,为递增计数;X=0时,为递减计数。状态转换图如
图5.4.12所示。试画出逻辑电路图。

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第2题
试用JK触发器和门电路设计一个同步七进制计数器。

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第3题
试用JK触发器和与非门设计一个十三进制加计数器。
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第4题
试用两个JK触发器按步骤设计一个同步时序电路。要求该电路有两个输入E、X。当E=0时,不管X的值等于几,触发器状
态都保持不变;当E=1时,若X=0,则触发器状态按00,01,10,11顺序循环;若X=1,则触发器状态按11,10,01,00顺序循环。
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第5题
用JK触发器设计一个同步六进制加1计数器。

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第6题
试用正边沿JK触发器设计一同步时序电路,其状态转换图如图3.30所示,要求电路最简.

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第7题
试用D触发器和门电路设计一个七进制计数器,并检查设计的电路能否自启动。

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第8题
用触发器实现同步时序电路。 (1)用J-K触发器设计一个模为8的格雷码同步计数器。 (2)用D

用触发器实现同步时序电路。 (1)用J-K触发器设计一个模为8的格雷码同步计数器。 (2)用D触发器设计上述题目。 (3)几点说明。

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第9题
试用上升沿D触发器构成异步3位二进制加法计数器,要求画出逻辑电路图,以及计数器输入时钟CLK与D触发器输出端Q2~Q0的波形图。

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第10题
试用T触发器和门电路构成D触发器和JK触发器。

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第11题
试用74xx161构成同步模24计数器,要求采用两种不同的方法。

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