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[单选题]
中规模集成计数器74LS161的并行输入控制端为（)。
A.第1引脚
B.第7引脚ENP
C.第10引脚ENT
D.第9引脚
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某系统为了提高采样速率,采用4片模数(全并行A/D)转换器构成并行交替式数据采集系统,原理框图如图7.20所示.系统信号源为30MHz的方波,时钟信号CLK为10MHz(要求占空比为1:1).并行交替式数据采集系统利用4片ADC轮流对同一个模拟输入信号进行采样,分别存人各路对应的64单元的存储器中,其对应各路AD所需的采样信号波形如图7.21所示,脉冲分配电路可用计数器+译码器构成.试根据系统设计参数要求,完成各部分电路的设计,器件任选.
(1)分频电路;
(2)脉冲分配电路;
(3)地址发生器电路设计;
(4)说明每个地址发生器所使用的时钟信号分别是什么？
图P11.5所示电路是用CB7520和同步十六进制计数器74LS161组成的波形发生器电路.已知CB7520的
,试画出输出电压v0的波形,并标出波形图上各点电压的幅度.
A一呼百应 铺天盖地 B自上而下 不可逆转
C有条不紊 举世瞩目 D运筹帷幄 波涛汹涌
已知如题图7-5所示电路中的集成运算放大器满足理想化条件,试证明其输出电压为
(提示:假设运算放大器线性工作，设定一个输入端电压U+=U-=U,利用虚断特点和AR2上下两个结点KCL进行分析。)
A.一呼百应 铺天盖地
B.自上而下 不可逆转
C.有条不紊 举世瞩目
D.运筹帷幄 波涛汹涌
