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[单选题]
地址输入端为8、数据输出端为4的ROM芯片，其存储容量应表示为（)。
A.16×4bit
B.32×8bit
C.256×4bit
D.512×8bit
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8:3线优先编码器真值表如下表所示,其中l0~I7为数据输入端(优先级I7为最高),ST为使能输入端,Y0~Y2为数据输出端,YE、YS为输出扩展端.用VHDL语言设计之.
试用1片八D锁存器74HC373设计一个能锁存两组BCD码信号的锁存电路。假定三态输出使能端
，锁存器原输出为
，输入为
，画出锁存器锁存新数据前、后使能端LE应输入的波形和相应Q0的波形。
A.8个输入端、5个控制端、13个输出端、2个电源端
B.13个输入端、5个控制端、8个输出端、2个电源端
C.5个输入端、13个控制端、8个输出端、2个电源端
D.13个输入端、8个控制端、5个输出端、2个电源端
画出图P5.10(a)中边沿触发D触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入端D的电压波形如图P5.10(b)所示。设触发器的初始状态为Q=0。
