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[主观题]

试用两个4位全加器附加必要的门电路,设计一个1位十进制加法器。提示:当两个数的和小于等于9(二进制1001)时,二进制和BCD码一致,当两个数的和大于9时,十进制的结果等于二进制的结果加6(0110)。

试用两个4位全加器附加必要的门电路,设计一个1位十进制加法器。提示:当两个数的和小于等于9(二进制1001)时,二进制和BCD码一致,当两个数的和大于9时,十进制的结果等于二进制的结果加6(0110)。

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第1题
试用4位并行加法器74LS283设计一个加/减运算电路。当控制信号K=0时将两个输入的4位二进制数相加,而K=1时它将

试用4位并行加法器74LS283设计一个加/减运算电路。当控制信号K=0时将两个输入的4位二进制数相加,而K=1时它将两个输入的4位二进制数相减,允许附加必要的门电路。

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第2题
试用4位同步二进制计数器74LS161接成十二进制计数器,标出输入、输出端,可以附加必要的门电路。

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第3题
试用8选1数据选择器CD4512和必要的门电路设计一个4位二进制码偶校验的校验码产生电路。

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第4题
试用十进制计数器芯片74HC160设计一个三百六十五进制的计数器。要求各数位间为十进制关系。允许附加必要的门

电路。

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第5题
试用两个双2线。4线译码器74HC139接成一个4线-16线译码器。74HC139的逻辑图详见4.2.1节中的图4.2.2。可以附加必要的门电路。
试用两个双2线。4线译码器74HC139接成一个4线-16线译码器。74HC139的逻辑图详见4.2.1节中的图4.2.2。可以附加必要的门电路。

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第6题
试用两个四位数值比较器组成三个数的判断电路。要求能够判别三个四位二进制数A(a3a2a1a0)、B(b3b2b1b0)、C(c3c

试用两个四位数值比较器组成三个数的判断电路。要求能够判别三个四位二进制数A(a3a2a1a0)、B(b3b2b1b0)、C(c3c2c1c0)是否相等,A是否最大,A是否最小,并分别给出“三个数相等”、“A最大”、“A最小”的输出信号。可以附加必要的门电路。

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第7题
试用4位全加器74HC283设计一个实现6位二进制数的5倍运算电路。

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第8题
试用中规模集成十六进制同步计数器74161,接成一个十三进制计数器,可以附加必要的门电路。

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第9题
试用1位全加器及适当的门电路构成1位加、减运算电路。当控制信号X=0时,电路实现加法运算;X=1时,实现减法运算。
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第10题
试用两片3-8译码器附加其他门电路,设计一个多功能组合逻辑电路。电路功能:P1P2是控制变量,X2X1是输入变量,Y2

试用两片3-8译码器附加其他门电路,设计一个多功能组合逻辑电路。电路功能:P1P2是控制变量,X2X1是输入变量,Y2Y1是输出变量,当P1P2取值00时,Y2Y1=X2X1;当P1P2取值01时,输出等于输入加1;当P1P2取值10时,输出等于输入减1;禁止P1P2取值11。

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第11题
位二进制同步计数器T1161及双4选1多路数据选择器T4153的功能表及逻辑符号如图7.2.12所示,试用其
设计一个能同时产生1110010及1010100两组序列的序列信号发生器(可附加少量门电路)。

位二进制同步计数器T1161及双4选1多路数据选择器T4153的功能表及逻辑符号如图7.2.12所示

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